assign sel_out = 16sel1 & in1 16sel2 & in2 16sel3 & in3;always posedge clk or negedge rstif!rst sel_reg_out = h0;else sel_reg_out = sel_out;sel_reg_out为16bit针对该逻辑写一个SV断言

日期: 2028-09-25
标签: 社会

assert property (posedge clk) disable iff (!rst) (rst |=> (sel_reg_out == 'h0)) && ((!rst && sel_out != 'h0) |=> sel_reg_out == sel_out);

assign sel_out = 16sel1 & in1 16sel2 & in2 16sel3 & in3;always posedge clk or negedge rstif!rst sel_reg_out = h0;else sel_reg_out = sel_out;sel_reg_out为16bit针对该逻辑写一个SV断言

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